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Cadence推出PCIe 6.0設計套件和採用台積電N5製程的測試晶片

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sxs112.tw
發佈時間: 2021-11-6 12:03

正文摘要:

幾周前PCI SIG發佈了PCIe 6.0規範的最終版草案。很快Cadence就提供了業內首批經過檢驗的IP封裝晶片。感興趣的開發者們現可借助Cadence的PCIe 6.0晶片設計套件，對各自的PCIe 6.0設計展開測試。如果一切進展順利我們 ...

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